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[ 2008年7月25日 ]


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將片外除錯的優點融入FPGA片上除錯之中

FPGA片上除錯已出現了很多年，成為傳統複雜FPGA設計除錯方法的一種常用替代方式，將虛擬測試夾具放於FPGA設計任何地方而不是採用昂貴的通用I/O接腳是可程式邏輯元件才有的性能。但片上除錯也有一些不足之處，本文將討論片上除錯的局限，並介紹如何把片上除錯與片外深採樣儲存特性結合起來。

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