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Cadence將與日本Starc攜手克服65奈米設計挑戰

EDA大廠Cadence Design Systems宣佈將向日本Starc研發聯盟提供其IC設計流程。該流程針對在Cadence Encounter數位IC設計平台上的65奈米設計進行了最佳化，能為Starc成員提供整合性的可製造性設計(DFM)和良率設計(design-for-yield)功能。

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