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[ 2008年7月25日 ]


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FPGA簡化高階記憶體介面設計

高性能系統設計師在滿足關鍵時序餘裕的同時，也要竭力取得更大頻寬，而記憶體介面是橫亙在實現上述目標道路上的性能瓶頸。雙倍數據速率SDRAM和4倍數據速率SDRAM都採用源同步介面來把數據和時脈(或閃頻)由發射器傳送到接收器。接收器介面內部利用時脈來鎖存數據，此舉可消除介面控制問題(如在記憶體和FPGA間的訊號傳遞時間)，但也為設計師帶來了必須解決的新挑戰。

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